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작성일 : 18-09-18 13:25
[전기/전자] 반도체 공정 관련해서 찾아보다 알게 된 내용 공유
 글쓴이 : 바람노래방
조회 : 4,293  

반도체 관련해서는 뭐가 많이 나오는데 아는게 없어서 좀 찾아보다 보니 알게된 재미난 내용이 있어 올려봅니다.
잘 아시는분들이 계시면 추가나 정정 내용 올려주시면 감사하겠습니다. ㅎㅎ



기존 반도체 생산 공정은 가장 중요한게 식각과 후공정(패키징)
그중에서 식각은 노광장비를 이용해 웨이퍼에 회로를 그리는 과정입니다.
여기서 노광장비는 레이저를 이용해 새기게 되는데, 문제는 이 레이저빔 파장의 두께가 198nm 로 엄청 두껍습니다.
지금 이 노광장비를 이용해 TSMC가 7nm 까지 새기고 있습니다.
그러니깐 두께가 198 단위인 칼로 7 단위 물건을 어떻게 깍아내는가 하는 의문이 생기죠.

여기서 공정기술이 들어가는데, 198nm의 노광장비에서 쏘는 레이저와 웨이퍼 사이에 물을 쏘아서 이 물이 볼록렌즈 역할을 하게 되어 198nm 두께의 레이저 광선을 훨씬 더 짧은 광선으로 줄여서 쏘게 되는 거라 합니다.

TSMC가 7nm 를 세기는 과정에는 이 물을 이중으로 넣어서 말하자면 볼록렌지를 두개 넣는 것과 같은 효과를 넣어 7nm 까지 레이저 광선을 줄이는 기술이라고 합니다.


삼성이 이번에 최초로 시도하게 되는 EUV는 기존 레이저 대신 극자외선을 빔으로 웨이퍼에 쏘게 됩니다.
삼성이 도입하는 EUV는 파장의 두계가 10nm로 레이저에 비해 거의 20분의 1수준이고
중간 공정기술 없이 그냥 쏴도 10nm 적용 가능한거죠.
(그전에 EUV를 도입하지 못했던 이슈는 일단 EUV 발광원(?) 개발이 힘들었고, 레이저에 비해 자외선은 식각이 가능할 정도의 힘이 없어서)
거기에 기존 볼록렌즈 역할 같은 공정기술을 넣으면 앞으로 훨씬 더 작은 파장으로 새길수 있게 되어 
한계에 다다른 기존 공정을 새로운 단계로 뛰어오를수 있게 될 거라 봅니다.





출처 : 해외 네티즌 반응 - 가생이닷컴https://www.gasengi.com


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개개미S2 18-09-18 16:01
   
그렇군요 좋은 설명 감사합니다.
가마솥 18-09-18 19:10
   
정보 감사합니다.
호갱 18-09-18 19:21
   
일단 euv 장비자체 생산수량도 한정적입니다...
수율도 안좋고요.
arfi 7nm 건너뛰고 간게 무조건 올바른 선택이고 이런건 알수없는겁니다
     
바람노래방 18-09-19 00:25
   
노광장비는 다 생산수량이 한정적입니다.
TSMC의 7nm 역시도 수율 안좋아요.
euv 관련 기사는 스크래치님이 올려주셨고
제가 마지막에 이야기 한건 TSMC의 7nm 는 레이저형의 끝단이라는 것이고, EUV는 이제 시작점이라는 것입니다.
Banff 18-09-19 00:33
   
회로설계와 공정설계는 전혀 다른거라, EUV 동작 원리는 디바이스 공정분야 전문가께 맡기고..

관련일 하는 사람에게 줏어들은건 예전에는 0.25um공정 그러면 트랜지스터 폴리게이트의 pitch 측정 길이였는데, 지금은 그 게이트 특성 넘버가 전통적인 mosfet 구조에서 finfet으로 넘어오면서 핀의 폭, 또는 마케팅 넘버로 본다는 군요.  위키에도 간략 설명이 있네요. 예를 들면 삼성과 TSMC 7nm공정의 트랜지스터 폴리 게이트 폭은 54nm, 메탈 wire 폭은 36 또는 40nm.

https://en.wikipedia.org/wiki/7_nanometer#7_nm_process_nodes
The naming of process nodes by different major manufacturers (TSMC, Intel, Samsung, GlobalFoundries) are partially direct lies (aka “marketing”) and not directly related to any measurable distance on a chip – for example TSMC's 7 nm node is similar in some key dimensions to Intel's 10 nm node.
 
레이저의 파장은 계속 줄일 수는 있겠지만, 여하튼 실리콘 원자의 갯수는 한정적인거라 계속 줄이는데는 한계가 생기죠. 실리콘 공유결합 원자간 거리가 대략 0.2nm이니까, 7nm가 실리콘 원자 35개, 3nm가 15개정도 들어가는 길이. 대략 10년후면 원자레벨 미세공정 기술개발은 거의 끝이 나지 않을까 싶어요.
     
바람노래방 18-09-19 13:46
   
제가 알아들을수 있는 수준이 아니네요!
역시나 이 분야는 좀만 깊이 들어가면 외계어처럼 들립니다 ㅎ
          
Banff 18-09-20 01:53
   
이건 디바이스 공정 종사자가 설명해주시는게 좋은데.  여하튼 한글 사이트 잘 정리된게 아래 하나 있네요.  댓글 리뷰도 좋고.  GF 7nm 포기하기전인 올해 7월에 정리된 글 또는 기사인데, TSMC/삼성 7nm와 비슷하게 놓고 보면 될듯합니다.

* 인텔 10nm vs. 글로벌파운드리 7nm
https://quasarzone.co.kr/bbs/board.php?bo_table=qn_hardware&wr_id=174075
멀리뛰기 21-01-02 14:50
   
[전기/전자] 반도체 공정 관련해서 찾아보다 알게 된 내용 공유 좋은글~
멀리뛰기 21-01-08 14:38
   
[전기/전자] 반도체 공정 관련해서 찾아보다 알게 된 내용 공유 감사^^
 
 
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